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pcb設計的一些經驗分享

發布時間:2019-12-19 14:00:00 點擊量:1206

  大家在看到一個pcb成品時,內心是不是充滿著自豪呢?是不是覺得人類的智慧特別偉大呢?其時有這樣的想法都是正常的,畢竟pcb的出現無疑是一件十分棒的事情。但是在利用它之前,大家是否知道它的出現不是一瞬間的,相反它需要經過pcb設計才可以得出來。同樣,專業的設計師在針對pcb設計的過程中會注意細節的方方面面,只有嚴格把關好這些細節上的事項,只有合理地進行布線連接才可以順順利利的讓電路板騰空出世。

 

  下面的內容是東莞市博遠電子有限公司針對pcb設計的一些經驗分享,希望對有需求的人提供一些幫助:

 

  首先,pcb設計師不是只會設計的,他們需要掌握的知識有很多,至少要十分了解各類電子元器年的工作原時,只有了解它們,只有知道它們彼此之間的關聯,只有了解它們之間的影響,才能夠更加清楚地知道輸入與輸出的傳輸標準,而且任何優秀成功的電子產品都是以原理圖作為依托的,所以pcb設計師對版圖技術了解到位,才能夠避免后續工作中發生重大問題。

 PCB板

  然后,pcb設計過程中的噪聲處理也迫在眉睫。目前要解決噪聲問題,那么就需要從三個方向入手。振鈴和串擾的問題,特別是一些關鍵性的信號要注意下串擾事項,合理地運用好差分信號,走線時利用好差分對走線,才可以從根本上消除感應的問題,并且保證路徑的順利進行,避免發生反彈的噪聲等等;pcb設計過程中,阻抗匹配度也是個要把關起來的問題,這一點是無比重要的,畢竟很多時間兩根線間的走線還是十分靠近的,所以pcb設計師們需要事先同廠家商定好使用怎樣的阻抗才行;pcb設計過程中的電容使用事項,合理采用一下去耦電容器更有助于減小線路板的電源和地平面之間的電感,只有盡量控制好這點才可以保障后面工作的順利。

 

  其次,pcb設計的過程中十分有可能會經受著時鐘信號干擾的相關問題,大抵上的原因還是鐘線過分長千萬的,所以pcb設計的過程中需要避免使用多個層來傳輸時鐘,并且不要在時鐘線上有過孔,因為過孔將增加走線的阻抗變化和信號的反射。其次,如果必須用內層來布設時鐘,那么上下層應該使用地平面來減小延遲。再次,如果電源平面上不幸引入時鐘噪聲會增加PLL抖動,那么在修改PCB設計時可以創建一個電源島,這種技術可以利用金屬平面中的較厚蝕刻來實現PLL模擬電源和數字電源的隔離。

 

  最后一點,東莞市博遠電子有限公司的工程師要講的是有關于pcb設計時的布局問題,大家都了解到pcb設計過程中最關鍵的還是連接,只有選擇恰當的、直接的路徑,才能夠收獲更好的效果,而這方面知識的掌握可以獲得更大的快樂,那么為什么不重視起來呢!

 

  

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